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1000：

1001：

1010(不亮了，從1010到1111都是全黑的狀態(tài) ，就放一個(gè)就行了)：

D鎖存器
前面所講的組合邏輯電路有個(gè)特點(diǎn) ，就是任何時(shí)候的輸出僅僅只由同一時(shí)刻的輸入所決定，而我們接下來涉及的時(shí)序邏輯電路呢，可不僅僅是那么簡單了。
它的輸出不但由輸入量控制，而且與它在上一個(gè)時(shí)刻的輸出有關(guān) 。
【至于所謂的“上一個(gè)時(shí)刻”到底是什么時(shí)刻這里我們先不管】。
時(shí)序邏輯電路最重要的組成部分是觸發(fā)器，觸發(fā)器有很多種，我們就介紹比較普遍的D觸發(fā)器即可。
為了深入了解觸發(fā)器，我們從構(gòu)成觸發(fā)器的鎖存器開始介紹咯。

1：用與非門構(gòu)成的SR鎖存器
鎖存器是何許人物也?
鎖存器是能保存上一刻的輸入的一個(gè)小電路。
怎么保存呢?基本思路就是：把輸出端口想辦法連回輸入端口就ok啦。
那么基本思路就是這樣：

在此基礎(chǔ)上，用與非門構(gòu)成的SR鎖存器橫空出世了。
這個(gè)電路僅僅由兩個(gè)與非門構(gòu)成，是相當(dāng)?shù)暮唵蔚?。
如圖所示：

至于為什么用SR這個(gè)名稱，因?yàn)檫@兩端各有置一(set)的功能和清零(reset)的功能。
現(xiàn)在來分析這個(gè)電路。
為了讓說明清楚些，我將上一刻的輸出記為Q ，此刻的輸出記為Q* 。
這個(gè)電路不外乎以下4種情況：
先看前三種，我們一步步分析。

接下來就是最重要的第四種情況了， Q*=Q的情況，此時(shí)Q*=Q 。

最后我們有如下的功能表給大家作參考：

2.D鎖存器
上面的sr鎖存器有個(gè)缺陷，就是當(dāng)s和r同時(shí)由0變成1的時(shí)候，輸出端Q會(huì)發(fā)生什么，難以預(yù)測。
總之，為了以防萬一， S和R同時(shí)為0的情況還是不要出現(xiàn)了，反正留著沒什么用。
D鎖存器就是為了阻止S和R同時(shí)為0的情況而出現(xiàn)而設(shè)立的鎖存器。
電路圖如下，在SR鎖存器的基礎(chǔ)上，加了兩個(gè)與非門。
順帶一題，與非門在電路實(shí)際應(yīng)用里的作用實(shí)在是太重要了，給我與非門，我可以連出任何電路 ?；厝グ雅c非門的功能表好好記住吧。